生物电模拟前端：ADS1299 与右腿驱动

为什么不能拿 STM32 内置的 12 位 ADC 直接采脑电？算一笔账就知道死在哪。EEG 幅度 5-100 μV，而人体泡在市电的容性耦合场里，身上感应的共模干扰是 V 级——信号与干扰差 6 个数量级。12 位 ADC 量程 3.3 V，最小分辨台阶约 800 μV，信号本身连一个 LSB 都够不着。先放大再采集是唯一的路，而"放大"两个字里藏着一整场战争：信噪比的战争，战场在 PCB 上。

数字端帮不上这个忙。放大之前信号还没进 ADC，一切数字手段都无从谈起；放大本身如果不干净，后面采样率再高、滤波器再 fancy 也只是精确地放大噪声。模拟前端是生物电系统里唯一没有"事后补救"机会的一环——这是它值得单写一篇的根本原因。

把这场战争的数量级摆开看更清楚。假设你的差分放大器做到 80 dB CMRR（入门水平），1 V 共模残余是 100 μV——和 EEG 信号同量级，等于信号被噪声淹没一半。要做到"残余是信号的百分之一"，CMRR 必须 > 120 dB，而且要在电极不平衡（两枚电极阻抗差 10 kΩ 以上）的残酷条件下保持。这不是一个"选一颗好芯片"就能解决的问题，而是一整条模拟链路的系统性工程：芯片、电路拓扑、滤波器、PCB 布线、供电方式，每一环都要为信噪比让路。

战争的五件兵器与各自对抗的敌人，先列一张总表，后面逐件展开：

这五件兵器，2013 年之前要三十颗分立芯片搭出来，调通一块板要一个老师傅带一个研究生干仨月；之后 TI 把它们收进了一颗 8 × 8 mm 的芯片。但注意：芯片吃掉的是电路设计，PCB 上的仗还得自己打——这也是本篇后半部分的存在理由。

先看那颗芯片自己是怎么打的。

一、ADS1299：一颗芯片替代 30 颗分立元件

ADS1299 的架构框图值得对着看十分钟，因为它就是一份"生物电 AFE 待办清单"的实物化：

• 8 通道 24 位 ΔΣ ADC：ΔΣ 架构用过采样换分辨率，调制器跑在 MHz 级，数字抽取滤波器直接吐出 24 位数据；配合 PGA 前级，等效输入噪声做到 1 μVpp（250 SPS、增益 24 时）——EEG 的最小可靠信号刚好骑在这条线上。
• 每通道集成 PGA：增益 1-24 可编程，EEG 通常设 24，把 μV 级信号拉到 ADC 满量程附近；通道各自独立，可以一路设 24 采 EEG、另一路设 6 采 sEMG。
• 集成右腿驱动（RLD）放大器：内部求和各通道共模、反相、缓冲输出，只留一个引脚和一枚限流电阻给用户（第三节细讲）。
• 导联脱落检测：可配置注入 0.5-7.5 nA 微弱电流测电极阻抗，凝胶干了、电极掉了立刻在状态位报警，而不是让你看着一屏噪声猜原因。
• SPI 串行接口 + 内置振荡器：8 通道数据打包成一帧 216 bit（状态字 + 8 × 24 bit）连续读出，DRDY 引脚拉低即数据就绪。

家族还有几个兄弟值得认脸：ADS1299-4 和 ADS1299-6（4/6 通道版，引脚兼容，通道数不够时省钱）、ADS1299-8（裸芯，可多芯片堆叠做 64 导系统——多片共享 SPI 总线时用 DAISY_EN 菊花链模式级联，一根总线读所有通道）。多芯片菊花链是高导联系统的标准答案：每片 ADS1299 的 DOUT 接下一片的 DIN，数据像串珠一样传出来，SPI 时钟和 DRDY 全板共享——64 导 EEG 头盔的内部就是这么串的。

关键指标两条，值得抄在笔记本第一页：

CMRR 110 dB 是这颗芯片的灵魂——意味着 1 V 共模干扰经过它只剩约 3 μV，正好压在信号量级之下。这就是"一颗芯片替代 30 颗分立元件"的本质：不是省面积，是把 CMRR 的兑现从"PCB 布线手艺"变成"芯片内部出厂保证"。分立方案布线差 1 cm，100 dB 就可能变 80 dB，差的那 20 dB 要在数字端用几百行代码和牺牲通带偿还。

ΔΣ 架构为什么适合这里，值得多说两句。传统逐次逼近型（SAR）ADC 一次转换一次输出，要分辨 μV 级就得把内部比较器噪声做到极低，成本陡增；ΔΣ 用 1-bit 调制器以 MHz 级速率粗采样，靠后续数字抽取滤波器把噪声搬移到带外——用速度和数学换分辨率，正好是 CMOS 工艺最擅长的交易。代价是群延迟：抽取滤波器的建立时间使 ADS1299 的输出比模拟输入滞后约 1 ms（250 SPS 时）——对 EEG 完全无感，对需要微秒级同步的多模态系统要在时间戳里记账。

24 位字长还有一个容易被问的问题：24 位 = 16.7M 个码，±2.5 V 量程下一个 LSB 约 300 nV，而输入噪声 1 μVpp 意味着低几位淹没在噪声里——24 位不是 24 位有效分辨率，但恰恰是这些"噪声位"在过采样平均后还能再换回一点分辨率。对 EEG 应用，250 SPS 下有效位约 21-22 位，已经远超需求；真正吃满 24 位的场合不存在，这是 ΔΣ 的诚实数学，不是营销水分。

驱动这颗芯片主要是配置寄存器 + 等 DRDY + 读帧，一个最小化的初始化序列长这样（Python，经 FTDI/USB-SPI 桥）：

def ads1299_init(spi):
    spi.xfer([SDATAC])                  # 先停连续读，才可写寄存器
    spi.xfer([WREG | CONFIG1, 0x00 - 1,
              0x96])                    # 250 SPS 采样率
    spi.xfer([WREG | CONFIG2, 0x00 - 1,
              0xC0])                    # 内部产生测试信号源
    spi.xfer([WREG | CONFIG3, 0x00 - 1,
              0xDC])                    # 内部参考电压使能、RLD 缓冲开
    for ch in range(8):                 # 八通道统一: 增益 24、
        spi.xfer([WREG | (CH1SET + ch), 0x00 - 1,
                  0x60])                # 正常输入、增益 24
    spi.xfer([WREG | MISC1, 0x00 - 1,
              0x20])                    # SRB1 作为所有通道负端
    spi.xfer([RDATAC])                  # 回到连续读模式
    # 之后每个 DRDY 下降沿读 27 字节: 3 状态 + 8×3 数据

SRB1 这个配置值得多说一句：把 8 个通道的负端全部接到同一个参考电极（通常贴在耳垂或乳突），一枚电极当八个通道的公共端，省电极也省面积——EEG 参考电极的标准玩法，写进寄存器就生效。代价是所有通道共享一个参考点，参考电极的噪声会进所有通道；想要每通道独立差分（sEMG 常用双极导联，每块肌肉一对电极），就把 SRB1 关掉、各通道负端接自己的电极。

时钟与供电是两颗容易翻车的暗雷。内部振荡器省事但抖动指标一般，追求极致噪声时用外部低抖动时钟；供电必须干净——模拟电源轨（AVDD/AVSS ±2.5 V）上的纹波会经 PSRR 有限抑制后直接调制进数据，LDO 输出接 0.1 μF + 10 μF 去耦是底线，数字电源（DVDD）与模拟电源分开走线。芯片再好，喂它的电不干净， datasheet 的指标就是废纸。

调通第一块板时的验证顺序也值得记录：先读器件 ID 寄存器确认 SPI 通信正常 → 发内部测试信号（CONFIG2 置 TESTSIG 位）确认各通道能读到 1 mV 方波 → 电极接自己（最好先接模拟人体电阻，别直接上人）看基线噪声 → 最后才碰 RLD 和增益配置。一次只改一个变量，是模拟调试与软件调试共通的美德。

二、分立方案还活着吗：INA128 / AD8421 的存量地盘

有了 SoC，仪表放大器路线并没死，它退守到两块自留地，而且守得很稳。

第一块是教学。想真正理解 CMRR、共模输入范围、右腿驱动这些概念，用 INA128 搭一遍比读十遍 datasheet 有效。三运放架构的仪表放大器，前级两个运放提供高阻抗差分输入，后级差分转单端，增益由一枚外接电阻设定：G = 1 + 50kΩ/RG，要 100 倍增益就接一枚 510 Ω。CMRR 标称 120 dB（DC、增益 ≥100 时），把"差分放大杀共模"从课本名词变成面包板上的可见波形。ADS1299 是黑盒，出问题只能查寄存器；分立方案每个节点都能挂示波器，错了知道错在哪——这是学习模拟电路的不可替代价值。

教学路线还有一层价值：读懂分立方案的每一级，才能读懂 ADS1299 的框图为什么长那样。PGA 对应仪表放大器前级、RLD 放大器对应你自己搭的反相注回电路、导联脱落检测对应你手边的阻抗测量——SoC 不是取消了知识，是把知识折叠进了芯片，展开折叠的最好办法就是亲手搭一次分立版本。

第二块是单通道 sEMG。sEMG 幅度 0-10 mV，比 EEG 大两个数量级，对噪声和 CMRR 的要求宽松得多——INA128（几美元）加一颗外置 16 位 ADC 就能做出可用的单通道肌电采集，成本和板面积都优于逼着 ADS1299 八通道闲置七个的用法。AD8421 则是宽带版本（10 MHz 带宽、470 μV 失调），适合针肌电（EMG 单纤维放电）这类高频小信号应用。

分界线画在通道数与信号级别：

还有一个正在长大的第三选项：国产集成 AFE（如 AFE 的国产兼容路线）和 Analog Devices 的 AD7124 这类通用 24 位 ΔΣ。它们的生物电专用功能（RLD、导联脱落）不如 ADS1299 全，但价格友好、供货稳定，做原理样机或对功能要求不完整的项目可以进入候选——选型时先列"必须有"的功能清单，再让芯片来投标，比反过来"先看上某颗芯片再说服自己"少走弯路。

多通道 EEG 一律 ADS1299，单通道 sEMG 和教学验证用分立，别反过来——用 ADS1299 教模电是浪费黑盒，用分立搭 64 导 EEG 是浪费人生。

分立路线自己的坑也交代两句，帮准备上路的人排雷。第一个坑是输入偏置电流通路：仪表放大器的输入偏置电流需要经过电极回到人体，如果电路里没有给偏置电流提供直流回路（比如串了隔直电容却没加泄放电阻），输入端会缓慢充电饱和，表现是"上电正常、几分钟后漂没"。第二个坑是增益分配：一级拉满 1000 倍会把失调电压也放大到淹没信号，正确做法是前级仪表放大器取 10-50 倍（利用其高 CMRR），后级普通运放再放大——增益和 CMRR 都是前级的事，后级只管把电平抬够。第三个坑是单电源供电时的虚地：生物电信号双极性，单电源系统需要一个低阻抗虚地（VCC/2）做参考，一枚电阻分压加运放缓冲是最低配置，直接用电阻分压当虚地会被每个接入的负载拉偏。

三、右腿驱动：为什么叫"右腿"，为什么必须限流

差分放大杀不掉的共模残余，靠 RLD 主动出击。原理三步走：从各通道输入端等权重取出共模平均电压 → 缓冲并反相放大 → 通过一枚参考电极注回人体。人体现场的等效模型是：共模干扰源经容性耦合灌入人体，人体经电极阻抗连到放大器。RLD 注入的反相信号在人体上叠加出一个与原干扰幅度相近、相位相反的分量，负反馈把共模残余再压低 20-40 dB。这不是滤波是主动抵消——干扰不是被挡住，是被"顶"回去的。

名字是心电时代的历史遗产。ECG 标准导联把电极贴在四肢：左臂、右臂、左腿都承担测量任务，右腿空出来——于是右腿被分配做驱动电极，"右腿驱动"（Right Leg Drive）由此得名。到了 EEG 年代电极全贴头上，驱动电极也常改放在乳突或头顶，但名字没人改，硬件工程师的术语保守主义又一例。

值得算一笔抵消的账，看 RLD 到底买回多少信噪比。设电极不平衡 10 kΩ、1 V 共模、放大器 CMRR 100 dB：不加 RLD 时，共模经不平衡阻抗转差模的部分约 1 mV 级（Vcm × 不平衡/输入阻抗量级的粗估），加上 CMRR 残余约 10 μV——前者才是大头。RLD 把人体上的共模本身压低 20-40 dB`，于是"转差模的原材料"直接少了一个数量级以上。RLD 的真正目标不是残余差模，是共模源头本身——这就是它和差分放大（处理结果）的本质分工：一个治病根，一个治症状。

RLD 串联电阻的安全取值是本篇最严肃的一段。这枚电阻在正常工作时毫不起眼——驱动电流本来就是 μA 级以下；它在故障时是患者唯一的限流屏障：若放大器输出意外对电源轨（±2.5 V 或更高），人体—RLD 回路电流 I = V/R。人体安全电流的红线数字：50-60 Hz 交流下 10 μA 量级刚可感知，100 μA 即可诱发心室颤动——这就是 IEC 60601 把 CF 型应用部分患者辅助电流限值定在 10 μA 的依据。所以 RLD 注入路径串 ~1 MΩ 量级电阻，即使放大器满摆幅 5 V 对地短路，故障电流也只有 5 μA，钉死在安全限内。代价是抵消深度变浅（大电阻限制了可用驱动电流）——安全的钱从来不能省，抵消不够可以数字端补，命没了不能补。

工程实现上这枚电阻还有讲究：用两枚 500 kΩ 串联替代单枚 1 MΩ（单点故障时仍有单枚限流，冗余一道）、选高阻抗封装（0805 以上，表面漏电路径长）、绝不用电位器（振动漂移 + 单点失效模式差）。这些细节 datasheet 不会替你想，医疗审核员会。

顺带一提，RLD 失效模式里最隐蔽的一种是"看起来在工作"：环路增益因电极阻抗劣化而悄悄下降，共模抑制从 40 dB 贡献掉到 15 dB，系统整体噪声变大但没有报警。对抗它的办法是把 RLD 环路增益做成可遥测量——定期注入已知测试信号读回抵消深度，做趋势监控。模拟电路的衰老是渐变的，不做趋势监控就只能等用户抱怨。

还有一个常被忽略的动态问题：RLD 是闭环反馈，人体电极阻抗是环路内的变量——电极阻抗漂移几十 kΩ，环路增益就跟着漂，相位裕度差的设计会在这个漂移范围内振荡。所以 RLD 环路带宽通常只留几 kHz，并在反馈网络里放补偿电容把高频极点提前；Spinelli 1999 年那篇经典论文专门讲怎么用跨导驱动结构让环路更稳（见参考文献）。

实测时的判别方法也简单：示波器挂 RLD 输出引脚，看到 MHz 级振荡就是环路不稳，加大补偿电容或降低环路增益；看到低频大幅摆动则是电极接触不良在周期性断续。RLD 的输出波形是整个前端健康状态的窗口，量产测试里值得留一个检测点。

四、滤波器：模拟与数字的分界线

生物电 AFE 的滤波分工有一条铁律：抗混叠必须在模拟域，其余都可以推给数字。

为什么抗混叠不能数字化：采样率 fs 定下之后，所有超过 fs/2 的噪声都会以镜像方式折叠进通带，且事后永远无法分离。生物电现场的超带噪声不客气——开关电源的 MHz 级尖刺、手机 TDMA 的 217 Hz 脉冲群、电机电刷的宽带干扰，折叠回来正好落在你的信号频段里。所以 ADC 前必须有一阶到二阶的低通抗混叠，哪怕滚降不陡，先把带外能量压到量化噪声以下。

折叠的数学一句话就能记住：频率 f 的噪声采样后出现在 |f - k·fs|（取最靠近通带的那个 k）。举例：采样率 250 SPS，1 MHz 的开关噪声会折叠到 |1000.000 - 4000×0.25| = 0 Hz——直接骑在直流上变成基线漂移。你看到的漂移不一定是漂移，可能是 MHz 噪声的镜像，这个认知能省下无数盲目调直流工作点的时间。

模拟有源滤波器选巴特沃斯（通带最大平坦，EEG 幅度谱不被染色），别选切比雪夫（通带纹波会直接调制信号幅度，对幅值敏感的 ERD 分析是毒药）。但除了抗混叠那一级，模拟滤波越少越好：每加一级有源滤波就加一级失调、噪声和元件失配，而数字滤波零漂移零失配——数字滤波器是免费的午餐，唯一的代价是采样之前。

说到陷波，双 T 型 50 Hz 陷波器是元件配对敏感度的教科书反面案例。双 T 的凹口深度依赖两臂 RC 严格对称——任何 1% 失配，理论无限深的 notch 就退化成 20-30 dB 的浅坑。老一代心电机的双 T 用排电阻和 NPO 电容手工配对、加多圈电位器微调，装机时逐台校准；今天只在"ADC 前必须有模拟陷波"的特殊场合（超强工频环境、采集端无数字后处理能力）才值得付这个配对成本，其余场合交给数字 IIR 陷波——Q 值想多高多高，还不用批量校准。

抗混叠那一级的截止频率怎么定有现成公式可套：ΔΣ ADC 的数字抽取滤波器本身在 fs/2 处有相当的抑制，datasheet 会给出数字滤波器频响曲线，模拟低通只需要补足数字滤波器阻带不足的部分——ADS1299 在 250 SPS 时数字滤波器对 > 3 kHz 的抑制已超过 80 dB，模拟端一阶 RC（截止 1 kHz 左右）就足够扫尾。先读 datasheet 的数字滤波器频响，再决定模拟端要几阶，别上来就堆四阶有源滤波，那是给 SAR ADC 的旧礼数。

带内其余滤波分工的总账：模拟域只留抗混叠低通（必要）+ 一阶高通去直流漂移（可选），带通细节、50 Hz 陷波、伪影阈值全部数字域解决——这也是脑机接口与肌电：sEMG 信号处理与意图解码那篇第三节处理三件套的来源。

模拟与数字的分界线上还有个时间维度的考量：模拟滤波器的群延迟随频率变化（相变非线性），对波形形态敏感的应用（肌电触发的研究）要留意；数字 FIR 可以做成线性相位、群延迟恒定，这是形态保真需求下数字滤波的又一票优势。

五、PCB 灵魂：布线即电路

分立时代 CMRR 的实现一半在芯片、一半在布线；SoC 时代芯片那半买了出厂保险，布线这半还是你自己的手艺。四条铁律，每条都是前人用整批报废板换来的：

1. AGND / DGND 单点连接。模拟地与数字地各自成平面，在 ADC 芯片正下方（或供电入口处）一点相连。数字地平面上流淌着 SPI 时钟的开关回流，多点连接会让这些噪声渗进模拟地——共模抑制做了一上午，地环路十分钟全还回去。单点的那颗连接处有时还串磁珠，给高频噪声留条高阻路径。
2. 高阻抗输入保护环包地。EEG 电极阻抗 MΩ 级，输入引脚周围的漏电流通路就是增益误差和漂移源。在输入焊盘周围画一圈保护环，用与输入等电位的低阻抗信号驱动（通常接屏蔽驱动缓冲输出），环内电位梯度趋零、漏电流趋零。湿气和助焊剂残留是漏电温床——保护环内的板子必须清洗，这是工艺文件里该写死的一条。
3. 屏蔽线驱动。电极线缆的外屏蔽层不直接接地：线缆对芯线的寄生电容（约 100 pF/m）随长度和弯折变化，会吃掉 CMRR 的高频段。正确做法是用缓冲器把屏蔽层驱动到与芯线共模等电位——屏蔽层"跟随"信号，电容上没有压降变化，长线缆 CMRR 不塌。ADS1299 的屏蔽驱动可以直接复用 RLD 缓冲器。
4. 电池供电 vs 隔离电源。实验室 EEG 一块锂电池直接悬浮供电最干净——与大地没有回路，容性干扰无处可走。产品要连外部设备（PC、机器人）就必须隔离：隔离 DC-DC 加数字隔离器，注意隔离器件的寄生电容（pF 级）也是高频噪声的偷渡通道，选低寄生电容型号，别让隔离前级的努力败给一颗便宜的数字隔离器。

保护环再展开一层，因为它最反直觉。漏电流的大小由 I = V/R_泄漏 决定，V 是输入焊盘与相邻走线之间的电位差——保护环的思路不是提高 R（那是拼命清洗和三防漆的事），而是把 V 干脆变成零：环用输入自身的电位驱动，环内外没有压差，漏电流失去动力。这也是为什么保护环必须用低阻抗缓冲器驱动——如果用高阻抗信号直接当环驱动，环电位跟不上，V 又回来了。"等电位包围"是模拟布线里少数能算得上优雅的手法，静电计、pH 计、脑电放大器用的都是同一招。

电池与隔离的取舍还可以再算细一笔。锂电池悬浮的问题不是电而是运维：设备不能边用边充电（充电器一插，隔离就没了），电量管理成为产品体验的硬约束；隔离 DC-DC 的问题是一次性成本和板上噪声——隔离变压器的开关噪声（几百 kHz）如果布局不当会经寄生电容耦合进模拟区。实验室要干净选电池，产品要续航选隔离，两头都要的系统（如手术室设备）最终都是隔离方案加严格的开关噪声布局，没有免费的午餐。

四条铁律背后是同一个思想：高阻抗、高增益节点是整块板最脆弱的地方，布线的一切让路给它——电源走远路、数字走边角、晶振别挨着输入、输入对短而粗。

落到画板的具体动作，一份可以直接照抄的布局顺序：

1. 先定 ADS1299 的位置——它离板边缘要近（输入走短线），离 USB/以太网接口要远；
2. 模拟输入连接器排在 ADS1299 同侧，输入对并行紧贴走线，下方完整地平面参考；
3. RLD 与屏蔽驱动走线紧随输入对，去耦电容直接压在芯片引脚上（0.1 μF 离电源引脚 < 2 mm）；
4. 模拟地平面完整铺，数字区（MCU、SPI）缩到板的另一端，AGND/DGND 在芯片下一点相连；
5. 电池/隔离电源放数字侧，功率走线绝不穿过模拟区；
6. 最后才放测试点：RLD 输出、参考电压、AGND/DGND 连接点各留一个。

顺序本身就是优先级：先保信号，再保数字，最后保方便——测试点放不下可以飞线，输入走线长了神仙难救。

画完板还有一次"纸上验收"的机会，别浪费：把布线图打印出来，拿三种颜色的笔——红笔描所有模拟输入路径，蓝笔描 SPI 与时钟，绿笔描电源与地回流路径。三条规则：红蓝不交叉（交叉处必有耦合）、红与绿只在去耦电容处相遇、蓝的回流不穿过模拟区。这三条任何一条被违反，都意味着第一批板要交学费——纸上看出来的问题是免费的，焊出来才看出来的是按小时计费的。四层板的叠层也顺手定了：顶层信号、第二层完整地平面、第三层电源、底层慢速信号——完整地平面是所有规则里性价比最高的一条，任何"为了走线方便在地平面开槽"的行为都是在给共模干扰修高速公路。

六、医疗安全的一条底线

生物电 AFE 连着人体，就落进 IEC 60601 的管辖范围。应用部分按隔离程度分 B / BF / CF 型：B 型不浮地隔离（仅体表接触无电气接触，如血压袖带）、BF 型浮地隔离（体表电极，EEG/sEMG 的底线要求）、CF 型最严（可直接接触心脏，如心导管）。患者辅助电流限值：BF 型正常状态 100 μA、单一故障 500 μA；CF 型收紧到 10 μA / 50 μA。这就是 RLD 限流电阻取 MΩ 量级、爬电距离、隔离电源全部设计参数的法定源头——每一条安全条款背后都有事故报告。

这些数字的来历值得一提。10 μA 的 CF 限值不是理论计算，是上世纪六七十年代手术室事故数据的统计边界：微安级电流经心导管直接流过心肌时，诱发颤动的概率在 10 μA 以下开始陡降，标准就把红线画在了统计安全侧。医疗安全标准的每一行都是用命换的数据点——理解了这一点，就不会觉得那些"严苛"的漏电流要求是官僚主义。

三条最常被 DIY 者忽略的红线，单独拎出来：

• ** isolation 的爬电与电气间隙是物理尺寸**，不是电气参数：BF 型要求增强绝缘，一次侧到应用部分的爬电距离通常 ≥ 4 mm（污染等级 2），PCB 上开槽 + 跨槽元件选加强绝缘型号，这两件事在原理图上看不出来，只有布局评审能抓；
• 电池供电不自动等于安全：锂电池浮地系统如果充电口还连着市电充电器，隔离就被充电器"借道"了——要么充电时禁止使用（机械或电子联锁），要么充电口本身做隔离；
• 人体连接的机械强度：拉扯电极线不能把 PCB 上的元件扯松碰到一次侧——这是 60601 机械安全条款的管辖，接口处应力释放是硬件成本里省不掉的一项。

规范细节与 STO 安全回路一起，留给安全篇展开：穿戴式安全电路：STO 急停与医疗级隔离。

七、上电之前：一块 AFE 板的验收清单

画完板不等于有前端，验收不过的板和废铜的区别只在于占地方。一份按顺序执行的清单：

1. 不上电目检：极性元件方向、去耦电容是否压在引脚上、AGND/DGND 单点是否真的只有一点、保护环是否完整闭环没有断口；
2. 供电检查：电流表串入，静态电流与 datasheet 典型值对比（ADS1299 约 2 mA），电流翻倍先查焊接短路再查芯片损坏；
3. SPI 通信：读 ID 寄存器（应返回 0x3E），读写 CONFIG1 回读一致；
4. 内部测试信号：CONFIG2 使能 1 mV 方波，8 通道都应看到幅度一致的方波——这步同时验证了 ADC、PGA 和数字链路；
5. 输入短接基线：所有输入对地短接，记录 30 min 基线，峰峰值应 < 2 μV（G=24、250 SPS）；超标则按通道排查（多半是某路去耦虚焊或保护环断）；
6. 共模抑制实测：两输入并联接 50 Hz、1 Vpp 信号，读输出残余——这是整板 CMRR 的真值，> 100 dB 达标。想再进阶一步，把信号源换成可变频率（10 Hz-10 kHz 扫频），画出 CMRR 随频率的曲线——100 dB @ 50 Hz 但 60 dB @ 1 kHz 的板子，在开关电源旁边照样翻车；
7. 接模拟人体：51 kΩ 电阻串 0.1 μF 电容模拟电极-皮肤阻抗，再过一遍基线与共模测试——加了模拟阻抗后共模抑制通常会掉 10-20 dB，掉的这部分就是"电极不平衡税"，掉太多说明输入阻抗设计有问题；
8. 最后才允许接真人，且第一 volunteer 永远是工程师自己。

第 6 步的共模实测值得强调：datasheet 的 110 dB 是芯片的，板子的 CMRR 是你的——两者差多少，就是布线的成绩单。

验收之后的日常使用里，故障排查的常见模式也值得记录，都是重复发生率最高的几类：

• 基线整体漂移、慢慢饱和：偏置电流通路断了——查电极阻抗是否过高（干电极久置）、BIAS 电极是否脱落、输入端有没有漏掉的直流回路；
• 全通道 50 Hz 同步起伏：RLD 失效或 BIAS 电极接触不良——共模没人管了，先查 RLD 输出波形和限流电阻，再查 BIAS 电极；
• 单通道噪声大：该通道去耦电容虚焊、保护环断口、或电极本身问题——与相邻通道交换电极即可二分定位；
• 随机尖峰、间歇抽搐：数字干扰耦合进模拟区（SPI 走线离输入太近）或线缆被踩/被门夹——前者要改板，后者换线；
• 数据整帧错误、ID 读不对：SPI 时序余量不足——降 SCLK 或检查走线长度匹配，菊花链多片时尤其常见；
• 换季才出现的低频漂移：湿度变化让板面漏电流变大——清洗并补三防漆，保护环不是一劳永逸的。

排查的总原则是二分：先分软硬件（测试信号模式一开便知），再分板内板外（换电极/换线），最后分通道（交叉对照）——有这套流程，一块"玄学噪声"板通常一下午能定位到元件级。

参考文献

1. Texas Instruments. ADS1299-x Low-Noise, 8-Channel, 24-Bit Analog-to-Digital Converter for EEG and Biopotential Measurements Datasheet, SBAS499C.（噪声、CMRR、RLD 架构与寄存器配置的一手数据）
2. Texas Instruments. INA128 Precision, Low-Power Instrumentation Amplifier Datasheet, SBOS051.（三运放架构与增益设定）
3. Webster, J. G. (Ed.). Medical Instrumentation: Application and Design. 4th ed., Wiley, 2010.（右腿驱动原理、生物电放大与安全，第 6–9 章）
4. IEC 60601-1:2005+AMD1:2012. Medical electrical equipment — Part 1: General requirements for basic safety and essential performance.（B/BF/CF 应用部分与漏电流限值）
5. Spinelli, E. M., Martinez, N. H., & Mayosky, M. A. "A Transconductance Driven Right Leg Circuit." IEEE Transactions on Biomedical Engineering, vol. 46, no. 12, 1999.（RLD 环路稳定性与改进结构）

模拟端把信号从噪声里捞出来之后，剩下的是数字侧的战斗：脑机接口与肌电：sEMG 信号处理与意图解码——滤波、特征、分类四级流水线如何把 μV 级电位变成机器人的动作指令。

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